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我是运用quartus ii设计一个600进制的可逆计数

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我使用Verilog开发了一个以太网UDP通信，但是使用Wireshark无法抓取到FPGA发过来的任何包

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怎么用verilog语言设计一个100进制的可逆计数器，可以实现加减，置数，清零，进位，借位功能，大佬求帮助？

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使用quartus13.0进行仿真，出现这个界面，不知道是怎么回事

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请教一下，FFT IP核仿真的初始值的source_exp=6'h3f,source_imag=16'hffff,没有输出。。是什么问题

我的quartus ii 11.0好想出问题了，综合的时候出错，有大佬们给看一下

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请问在dsp中对事件管理器的的T1PR初始化时可以写入十进制的树吗？

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请问fft中采用同位运算为什么还要用两块ram，同位运算不是只有一个ram就好了吗？

FPGA需要外挂一个SRAM吗？

xilinx基本需要外置SRAM，但是国产都内置SRAM了，内置的SRAM性能是否会更好点？

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